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科目代碼 | AEC0015 | 課程名稱 | 數位信號處理架構設計 |
英文名稱 | DSP Architecture Design | ||
全/半年 | 半 | 必/選修 | 選修 |
學分數 | 3.0 | 每週授課時數 | 正課時數: 3.0 小時, 實驗時數: 0.0 小時 |
先修課程 | |||
課程簡介 | 學習數位訊號處理架構的原理與設計方法 | ||
課程目標 | 對應系所核心能力 | ||
1. 學習訊號與系統之基本理論模式 |
學士: 1-1 運用物理數學與電機電子工程知識與技術之能力 |
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2. 學習時序分析方式 |
學士: 1-3 規劃、設計及執行電機電子工程系統整合之能力 |
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3. 學習數位訊號處理之硬體設計 |
學士: 1-3 規劃、設計及執行電機電子工程系統整合之能力 1-4 發掘、分析與處理複雜且整合性工程問題之能力 |
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4. 英文講義 |
學士: 1-1 運用物理數學與電機電子工程知識與技術之能力 1-4 發掘、分析與處理複雜且整合性工程問題之能力 |